<学術雑誌論文>
A Simple Mechanism for Collapsing Instructions under Timing Speculation

作成者
本文言語
出版者
発行日
収録物名
収録物名
開始ページ
終了ページ
出版タイプ
アクセス権
権利関係
関連DOI
関連URI
関連HDL
概要 The deep submicron semiconductor technologies will make the worst-case design impossible, since they can not provide design margins that it requires. We are investigating a typical-case design methodo...logy, which we call the Constructive Timing Violation (CTV). This paper extends the CTV concept to collapse dependent instructions, resulting in performance improvement. Based on detailed simulations, we find the proposed mechanism effectively collapses dependent instructions.続きを見る

本文ファイル

pdf sato08_3 pdf なし 309 KB 193  

詳細

PISSN
EISSN
NCID
レコードID
査読有無
主題
タイプ
登録日 2023.07.27
更新日 2024.01.10